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 * @Author: ipk518 18163976442@163.com
 * @Date: 2024-11-27 19:58:01
 * @LastEditors: ipk518 18163976442@163.com
 * @LastEditTime: 2024-11-27 20:02:08
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 * @Description: 
 * @************佛祖保佑************
 * @Copyright (c) 2024 by etws@quyujiang, All Rights Reserved. 
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#ifndef __JESD204C_REG_H
#define __JESD204C_REG_H

#define XPAR_JESD204_PHY_1_BASEADDR 0xa0010000
#define XPAR_JESD204C_1_BASEADDR 0xa0090000

// #define JESD204C_IP_VERSION             0x00000000
// #define JESD204C_IP_CONFIG              0x00000004
// #define JESD204C_RESET                  0x00000020
// // #define JESD204C_CTRL_ENABLE            0x0024
// #define JESD204C_CTRL_TX_SYNC           0x00000028
// // #define JESD204C_CTRL_MB_IN_EMB         0x0030
// #define JESD204C_CTRL_SUB_CLASS         0x00000034
// // #define JESD204C_CTRL_META_MODE         0x0038
// #define JESD204C_CTRL_8B10B_CFG         0x0000003C
// #define JESD204C_CTRL_LANE_ENA          0x00000040
// // #define JESD204C_CTRL_RX_BUF_ADV        0x0044
// #define JESD204C_CTRL_TEST_MODE         0x00000048
// // #define JESD204C_CTRL_RX_MBLOCK_T       0x004C
// #define JESD204C_CTRL_SYSREF            0x00000050
// // #define JESD204C_STAT_LOCK_DEBUG        0x0054
// // #define JESD204C_STAT_RX_ERR            0x0058
// // #define JESD204C_STAT_RX_DEBUG          0x005C
// #define JESD204C_STAT_STATUS            0x00000060
// #define JESD204C_CTRL_IRQ               0x00000064
// #define JESD204C_STAT_IRQ               0x00000068
// #define JESD204C_CTRL_TX_ILA_CFG0       0x00000070
// #define JESD204C_CTRL_TX_ILA_CFG1       0x00000074
// #define JESD204C_CTRL_TX_ILA_CFG2       0x00000078
// #define JESD204C_CTRL_TX_ILA_CFG3       0x0000007C
// #define JESD204C_CTRL_TX_ILA_CFG4       0x00000080
// #define JESD204C_Lane0_CTRL_TX_ILA_LID  0x00000404
// #define JESD204C_Lane0_ CTRL_TX_GT      0x00000460
// #define JESD204C_Lane0_CTRL_RX_GT       0x00000464

#endif
